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             2nxp,imx8qxp-fspi            ]                   fspi_base fspi_mmap         6       \                                     jfspi_en fspi            v            	  Odisabled          mailbox@5d1b0000            ]             6                           	  Odisabled             2fsl,imx8qxp-mu fsl,imx6sx-mu          mailbox@5d1c0000            ]             6                           -   2fsl,imx8-mu-scu fsl,imx8qxp-mu fsl,imx6sx-mu                     mailbox@5d1d0000            ]             6                           	  Odisabled          -   2fsl,imx8-mu-scu fsl,imx8qxp-mu fsl,imx6sx-mu          mailbox@5d1e0000            ]             6                           	  Odisabled          -   2fsl,imx8-mu-scu fsl,imx8qxp-mu fsl,imx6sx-mu          mailbox@5d1f0000            ]             6                           	  Odisabled          -   2fsl,imx8-mu-scu fsl,imx8qxp-mu fsl,imx6sx-mu          mailbox@5d200000            ]              6                             v            	  Odisabled             2fsl,imx8qxp-mu fsl,imx6sx-mu          mailbox@5d210000            ]!             6                             v            	  Odisabled             2fsl,imx8qxp-mu fsl,imx6sx-mu          mailbox@5d280000            ](             6                             v               2fsl,imx8qxp-mu fsl,imx6sx-mu          clock-controller@5d400000            2fsl,imx8qxp-lpcg            ]@             |         4                                                                       h  pwm0_lpcg_ipg_clk pwm0_lpcg_ipg_hf_clk pwm0_lpcg_ipg_s_clk pwm0_lpcg_ipg_slv_clk pwm0_lpcg_ipg_mstr_clk         v                       clock-controller@5d410000            2fsl,imx8qxp-lpcg            ]A             |         4                                                                       h  pwm1_lpcg_ipg_clk pwm1_lpcg_ipg_hf_clk pwm1_lpcg_ipg_s_clk pwm1_lpcg_ipg_slv_clk pwm1_lpcg_ipg_mstr_clk         v                       clock-controller@5d420000            2fsl,imx8qxp-lpcg            ]B             |         4                                                                       h  pwm2_lpcg_ipg_clk pwm2_lpcg_ipg_hf_clk pwm2_lpcg_ipg_s_clk pwm2_lpcg_ipg_slv_clk pwm2_lpcg_ipg_mstr_clk         v                       clock-controller@5d430000            2fsl,imx8qxp-lpcg            ]C             |         4                                                                       h  pwm3_lpcg_ipg_clk pwm3_lpcg_ipg_hf_clk pwm3_lpcg_ipg_s_clk pwm3_lpcg_ipg_slv_clk pwm3_lpcg_ipg_mstr_clk         v                       clock-controller@5d440000            2fsl,imx8qxp-lpcg            ]D             |         4                                                                       h  pwm4_lpcg_ipg_clk pwm4_lpcg_ipg_hf_clk pwm4_lpcg_ipg_s_clk pwm4_lpcg_ipg_slv_clk pwm4_lpcg_ipg_mstr_clk         v            clock-controller@5d450000            2fsl,imx8qxp-lpcg            ]E             |         4                                                                       h  pwm5_lpcg_ipg_clk pwm5_lpcg_ipg_hf_clk pwm5_lpcg_ipg_s_clk pwm5_lpcg_ipg_slv_clk pwm5_lpcg_ipg_mstr_clk         v            clock-controller@5d460000            2fsl,imx8qxp-lpcg            ]F             |         4                                                                       h  pwm6_lpcg_ipg_clk pwm6_lpcg_ipg_hf_clk pwm6_lpcg_ipg_s_clk pwm6_lpcg_ipg_slv_clk pwm6_lpcg_ipg_mstr_clk         v            clock-controller@5d470000            2fsl,imx8qxp-lpcg            ]G             |         4                                                                       h  pwm7_lpcg_ipg_clk pwm7_lpcg_ipg_hf_clk pwm7_lpcg_ipg_s_clk pwm7_lpcg_ipg_slv_clk pwm7_lpcg_ipg_mstr_clk         v               clock-hsio-axi           2fixed-clock         |            ׄ         hsio_axi_clk                     clock-hsio-per           2fixed-clock         |            U        hsio_per_clk                     clock-hsio-refa          2gpio-gate-clock                    |                           clock-hsio-refb          2gpio-gate-clock                    |               m                        clock-xtal100m           2fixed-clock         |                     xtal_100MHz                  bus@5f000000             2simple-bus         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  _     _     _     _             reg phy ctrl misc         (                                       +  jpclk0 apb_pclk0 phy0_crr ctl0_crr misc_crr                     v              Ookay            pciea-x2-pcieb          input                       chosen          /bus@5a000000/serial@5a090000         gpio-keys         
   2gpio-keys           default                    Ookay       key-wakeup             
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